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图书馆IEEE;
使用IEEE.STD_LOGIC_1164.ALL;
使用IEEE.STD_LOGIC_ARITH.ALL;
使用IEEE.STD_LOGIC_UNSIGNED.ALL;

实体解码器是
Port (s: in STD_LOGIC_VECTOR (2 downto 0);
y: out STD_LOGIC_VECTOR (7 downto 0));
结束译码器;

译码器的行为是
开始
使用sel select
Y <="00000001"当"000"，
“00000010”当“001”，
“00000100”当“010”，
“00001000”当“011”，
“00010000”当“100”，
“00100000”当“101”，
“01000000”当“110”，
“10000000”当“111”，
“00000000”当别人;
端行为;