8085微处理器上的|架构
这个8085架构用框图描述了8085微处理器的内部模块。8085体系结构由控制单元、ALU、寄存器、累加器、标志、程序计数器、堆栈指针、指令寄存器、内存地址寄存器、控制寄存器等组成。
英特尔8085是1976年英特尔公司生产的8位微处理器。8085芯片的主要特点是8位数据总线，16位地址总线，3.072 MHz内部时钟频率，40引脚配置等。使用+5V电源电压工作。让我们了解8085微处理器的结构及其内部模块或单元。
8085年建筑
8085芯片是8位通用微处理器，可以处理64K字节大小的内存。8085架构由上述寄存器、标志和计数器组成。
图:18085微处理器架构框图
图1描述了8085微处理器的内部结构。大体上8085体系结构由三个单元组成，即处理单元、指令单元、存储单元和接口单元。
➨处理单元由ALU、累加器、状态标志和临时寄存器组成。
➨指令单元由指令寄存器、指令解码器、定时和控制单元组成。
➨存储和接口单元由通用寄存器、堆栈指针(SP)、程序计数器(PC)、增量/减量寄存器、地址锁存器、地址/数据锁存器组成。
➨其他三个单元分别是中断控制器，串行I/O控制器和电源单元，如图所示。
所有这些硬件模块作为8085架构的一部分已经在图中显示，并在8085芯片中使用了各自的引脚。所有8085引脚的功能见下表。
8085引脚图
图:28085引脚图
8085引脚图如图2所示。8085微处理器有40个引脚。它使用+5V电源，运行在最高频率约3 MHz。8085芯片上的引脚可分为6组:
•地址总线
•数据总线
•控制和状态信号
•电源和频率
•外部启动信号
•串行I/O接口
| 8085年销 | 描述 | |||||||||||||||
|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|
| AD0到AD7 | 有双向的。它们作为地址总线和数据总线。在指令执行过程中，这些线路最初作为地址总线，后来作为数据总线。外部闩锁与这些线路接口。 | |||||||||||||||
| A8至A15 | 这些是单向的地址总线线路。 | |||||||||||||||
| 啤酒 | (地址锁存使能)，当AD-AD7线路用作地址总线时，该脉冲值为1。在这之后它的值为0。这用于使锁存器从外部连接。 | |||||||||||||||
| 理查德·道金斯的 | 读取低激活信号。 | |||||||||||||||
| 或者说是“ | 写低激活的信号。 | |||||||||||||||
| IO / M” | 该信号指定操作是内存操作(IO/M' = 0)还是I/O操作(IO/M' = 1)。 | |||||||||||||||
| S1, S0 | 这些是指定8085微处理器正在执行的操作类型的状态信号。
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| SID | 串行输入数据线。每当执行RIM指令时，这一行上的数据就被加载到累加器的第7位。 | |||||||||||||||
| 草皮 | 串行输出数据线。根据SIM指令设置或重置输出SOD。 | |||||||||||||||
| INTR | 输入,中断请求。它被用作通用中断。INTR由软件开启和关闭。它被reset禁用，并且在中断被接受后立即禁用。 | |||||||||||||||
| 国际商标的 | 输出，中断确认;在INTR被接受后的指令周期中使用它代替RD。它可以用来激活8259中断芯片或其他中断端口。 | |||||||||||||||
| RST5.5、RST6.5 RST7.5 | 这是三个与INTR具有相同时间的输入，除了它们会导致内部RESTART自动插入。RST 7.5优先级最高，RST 5.5优先级最低。这些中断具有比INTR更高的优先级。 | |||||||||||||||
| 陷阱 | 输入，TRAP中断是一个不可屏蔽的重启中断。它不受任何掩码或中断启用的影响。它具有任何中断的最高优先级。 | |||||||||||||||
| RESET IN(输入) | 复位将程序计数器(PC)设置为零。它重置中断启用和HLDA触发器。其他标志或寄存器都不受影响。只要应用了reset, CPU就会保持在复位状态。 | |||||||||||||||
| RESET OUT(输出) | 表示CPU正在复位。它可以用作系统复位。信号与处理器时钟同步。 | |||||||||||||||
| CLK出来 | 一种输出时钟引脚，用于驱动系统其余部分的时钟。 | |||||||||||||||
| 准备好(输入) | 如果这个信号在读或写周期中很高，它表明内存或外设已经准备好发送或接收数据。如果READY值为低，CPU将等待READY值为高，然后完成读或写周期。 | |||||||||||||||
| (输入) | HOLD表示另一个MASTER正在请求使用地址和数据总线。接收Hold请求时的微处理器(CPU)。一旦完成当前的机器周期，将放弃使用总线。内部处理可以继续。只有移除Hold后，处理器才能重新获得总线。 | |||||||||||||||
| HLDA(输出) | 持有认可 它表示CPU已经接收到Hold请求，并将在下一个时钟周期放弃总线。HLDA在删除Hold请求后变低。CPU在HLDA降至低后的半个时钟周期内接受总线。 |
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| VCC | + 5 v供应 | |||||||||||||||
| VSS | 地面参考 | |||||||||||||||
| X1, X2 | 这些信号是来自晶体或时钟发生器的输入。 |
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